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『簡體書』SystemVerilog硬件设计

書城自編碼： 3982469
分類：簡體書→大陸圖書→計算機/網絡→程序設計
作者： [印]瓦伊巴夫·塔拉特[VaibbhavTaraate]
國際書號(ISBN)： 9787030783837
出版社： 科学出版社
出版日期： 2024-04-01

頁數/字數： /
書度/開本： 16开 釘裝： 平装

售價：HK$ 89.7

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內容簡介：
《SystemVerilog硬件设计：RTL设计和验证》侧重于使用SystemVerilog编写高效的RTL代码，通过大量示例代码展示如何使用SystemVerilog进行硬件设计和验证。　　《SystemVerilog硬件设计：RTL设计和验证》共分15章，内容包括SystemVerilog中的常量和数据类型、SystemVerilog的硬件描述、SystemVerilog中的面向对象编程、SystemVerilog增强特性、SystemVerilog中的组合逻辑设计、SystemVerilog中的时序逻辑设计、RTL设计和综合指南、复杂设计的RTL设计和策略、有限状态机、SystemVerilog中的端口和接口、验证结构、验证技术和自动化、高级验证结构、验证案例等。

 

 

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